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An integral path self-calibration scheme for a 20.1-26.7GHz dual-loop PLL...

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PLL

SOI

SOI

CMOS

CMOS是Complementary Metal Oxide Semiconductor(互补金属氧化物半导体)的缩写。它是指制造大规模集成电路芯片用的一种技术或用这种技术制造出来的芯片。是电脑主板上的一块可读写的RAM芯片。因为可读写的特性,所以在电脑主板上用来保存BIOS设置完电脑硬件参数后的数据,这个芯片仅仅是用来存放数据的。另外,CMOS同时可指互补式金氧半元件及制程。因此时至今日,虽然因为工艺原因,都叫做CMOS,但是CMOS在三个应用领域,呈现出迥然不同的外观特征:一是用于计算机信息保存,CMOS作为可擦写芯片使用,在这个领域,用户通常不会关心CMOS的硬件问题,而只关心写在CMOS上的信息,也就是BIOS的设置问题,其中提到最多的就是系统故障时拿掉主板上的电池,进行CMOS放电操作,从而还原BIOS设置。二是在数字影像领域,CMOS作为一种低成本的感光元件技术被发展出来,市面上常见的数码产品,其感光元件主要就是CCD或者CMOS,尤其是低端摄像头产品,而通常高端摄像头都是CCD感光元件。三是在更加专业的集成电路设计与制造领域。

标题:An  integral  path  self-calibration  scheme  for  a  20.1-26.7GHz  dual-loop  PLL  in  32nm  SOI  CMOS

作者:Mark  Ferriss,  Jean-Olivier  Plouchart,  Arun  Natarajan,  Alexander  Rylyakov,  Benjamin  Parker,  Aydin  Babakhani,  Soner  Yaldiz,  Bodhisatwa  Sadhu,  Alberto  Valdes-Garcia,  José  Tierno,  Daniel  Friedman

摘要:A  bandwidth  self-calibration  scheme  is  introduced  as  part  of  a  20.1GHz  to  26.7GHz,  low  noise  PLL  in  32nm  CMOS  SOI.  A  dual-loop  architecture  in  combination  with  an  integral  path  measurement  and  correction  scheme  desensitizes  the  loop  transfer  function  to  the  VCO\'s  small  signal  gain  variations.  The  spread  of  gain  peaking  is  reduced  by  self-calibration  from  2.4dB  to  1dB,  when  measured  at  70  sites  on  a  300mm  wafer.  The  PLL  has  a  measured  phase  noise  @10MHz  offset  of  -126.5dBc/Hz  at  20.1GHz.

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