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A 12.8GS/s Time-Interleaved ADC With 25 GHz Effective Resolution Bandwidth...

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标签: ADC

ADC,Analog-to-Digital Converter的缩写,指模/数转换器或者模拟/数字转换器。是指将连续变量的模拟信号转换为离散的数字信号的器件。真实世界的模拟信号,例如温度、压力、声音或者图像等,需要转换成更容易储存、处理和发射的数字形式。模/数转换器可以实现这个功能,在各种不同的产品中都可以找到它的身影。

hierarchical-sampling

ADC,Analog-to-Digital Converter的缩写,指模/数转换器或者模拟/数字转换器。是指将连续变量的模拟信号转换为离散的数字信号的器件。真实世界的模拟信号,例如温度、压力、声音或者图像等,需要转换成更容易储存、处理和发射的数字形式。模/数转换器可以实现这个功能,在各种不同的产品中都可以找到它的身影。

cascode-sampler

ADC,Analog-to-Digital Converter的缩写,指模/数转换器或者模拟/数字转换器。是指将连续变量的模拟信号转换为离散的数字信号的器件。真实世界的模拟信号,例如温度、压力、声音或者图像等,需要转换成更容易储存、处理和发射的数字形式。模/数转换器可以实现这个功能,在各种不同的产品中都可以找到它的身影。

A  12.8GS/s  Time-Interleaved  ADC  With  25  GHz  Effective  Resolution  Bandwidth  and  4.6  ENOB

作者:Yida  Duan,  Elad  Alon

摘要:This  paper  presents  a  12.8  GS/s  32-way  hierarchically  time-interleaved  SAR  ADC  with  4.6  ENOB  in  65  nm  CMOS.  The  prototype  utilizes  hierarchical  sampling  and  cascode  sampler  circuits  to  enable  greater  than  25  GHz  3  dB  effective  resolution  bandwidth  (ERBW).  We  further  employ  a  pseudo-differential  SAR  ADC  to  save  power  and  area.  The  core  circuit  occupies  only  0.23  mm  2  and  consumes  a  total  of  162  mW  from  dual  1.2  V/1.1  V  supplies.  The  design  achieves  a  SNDR  of  29.4  dB  at  low  frequencies  and  26.4  dB  at  25  GHz,  resulting  in  a  figure-of-merit  of  0.79  pJ/conversion-step.  As  will  be  further  described  in  the  paper,  the  circuit  architecture  used  in  this  prototype  enables  expansion  to  25.6  GS/s  or  51.2  GS/s  via  additional  interleaving  without  significantly  impacting  ERBW.

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