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An 87 fJ/conversion-step 12 b 10 MS/s SAR ADC using a minimum number of ...

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标签: SAR

该算法是第一个具有Qos意识的路由协议。该协议以基于路由表驱动的多路径方式满足网络低能耗和鲁棒性的要求。它的特点是路由决策不仅要考虑到每条路径的能源,还要涉及端到端的延迟需求和待发送数据包的优先级。

ADC

ADC,Analog-to-Digital Converter的缩写,指模/数转换器或者模拟/数字转换器。是指将连续变量的模拟信号转换为离散的数字信号的器件。真实世界的模拟信号,例如温度、压力、声音或者图像等,需要转换成更容易储存、处理和发射的数字形式。模/数转换器可以实现这个功能,在各种不同的产品中都可以找到它的身影。

模数转换器

模数转换器即A/D转换器,或简称ADC,通常是指一个将模拟信号转 变为数字信号的电子元件。通常的模数转换器是将一个输入电压信号转换为一个输出的数字信号。由于数字信号本身不具有实际意义,仅仅表示一个相对大小。故任 何一个模数转换器都需要一个参考模拟量作为转换的标准,比较常见的参考标准为最大的可转换信号大小。

《An  87  fJ/conversion-step  12  b  10  MS/s  SAR  ADC  using  a  minimum  number  of  unit  capacitors》

This  work  proposes  a  12  b  10  MS/s  0.11  μm  CMOS  successive-approximation  register  ADC  based  on  a  C-R  hybrid  DAC  for  low-power  sensor  applications.  The  proposed  C-R  DAC  employs  a  2-step  split-capacitor  array  of  upper  seven  bits  and  lower  five  bits  to  optimize  power  consumption  and  chip  area  at  the  target  speed  and  resolution.  A  V  CM  -based  switching  method  for  the  most  significant  bit  and  reference  voltage  segments  from  an  insensitive  R-string  for  the  last  two  least  significant  bits  minimize  the  number  of  unit  capacitors  required  in  the  C-R  hybrid  DAC.  The  comparator  accuracy  is  improved  by  an  open-loop  offset  cancellation  technique  in  the  first-stage  pre-amp.  The  prototype  ADC  in  a  0.11  μm  CMOS  process  demonstrates  the  measured  differential  nonlinearity  and  integral  nonlinearity  within  1.18  LSB  and  1.42  LSB,  respectively.  The  ADC  shows  a  maximum  signal-to-noise-and-distortion  ratio  of  63.9  dB  and  a  maximum  spurious-free  dynamic  range  of  77.6  dB  at  10  MS/s.  The  ADC  with  an  active  die  area  of  0.34  mm  2  consumes  1.1  mW  at  1.0  V  and  10  MS/s,  corresponding  to  a  figure-of-merit...

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