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VHDL语言入门教程

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标签: VHDL语言入门教程

VHDL语言入门教程

VHDL语言入门教程

文档内容节选

3 VHDL语言 VHDL VHSIC Hardware Description Language 31 VHDL语言基础 32 VHDL基本结构 33 VHDL语句 34 状态机在VHDL中的实现 35 常用电路VHDL程序 36 VHDL仿真 37 VHDL综合 HDLHardware Description Language 一种用于描述数字电路的功能或行为的语言目的是提为电路设计效率,缩 短设计周期,减小设计成本,可在芯片制造前进行有效的仿真和错误检测 优点: HDL设计的电路能获得非常抽象级的描述如基于RTLRegister Transfer Level描述的IC,可用于不同的工艺 HDL设计的电路,在设计的前期,就可以完成电路的功能级的验证 HDL设计的电路类似于计算机编程 常用的HDL语言:VHDL Verilog HDL VHDL 概述: VHDL VHSIC Hardwarter Description Language VHSIC Very High speed integrated circuit VHD......

3 VHDL语言 VHDL: VHSIC Hardware Description Language. 3.1 VHDL语言基础 3.2 VHDL基本结构 3.3 VHDL语句 3.4 状态机在VHDL中的实现 3.5 常用电路VHDL程序 3.6 VHDL仿真 3.7 VHDL综合 HDL----Hardware Description Language 一种用于描述数字电路的功能或行为的语言。目的是提为电路设计效率,缩 短设计周期,减小设计成本,可在芯片制造前进行有效的仿真和错误检测。 优点: HDL设计的电路能获得非常抽象级的描述。如基于RTL(Register Transfer Level)描述的IC,可用于不同的工艺。 HDL设计的电路,在设计的前期,就可以完成电路的功能级的验证。 HDL设计的电路类似于计算机编程。 常用的HDL语言:VHDL 、Verilog HDL VHDL 概述: VHDL VHSIC Hardwarter Description Language VHSIC Very High speed integrated circuit  VHDL是美国国防部在20世纪80年代初为实现其高速集成电路 硬件VHSIC计划提出的描述语言;  IEEE从1986年开始致力于VHDL标准化工作,融合了其它 ASIC芯片制造商开发的硬件描述语言的优点,于93年形成了标 准版本(IEEE.std_1164)。  1995年,我国国家技术监督局推荐VHDL做为电子设计自动化 硬件描述语言的国家标准。 VHDL优点:  覆盖面广,系统硬件描述能力强,是一个多层次的硬件描述语言;  VHDL语言具有良好的可读性,既可以被计算机接受,也容易被人们 所理解;  VHDL语言可以与工艺无关编程;  VHDL语言已做为一种IEEE的工业标准,便于使用、交流和推广。 VHDL语言的不足之处: 设计的最终实现取决于针对目标器件的编程器,工具的不同会导致综 合质量不一样。 3.1 VHDL语言基础 3.1.1 标识符(Identifiers) 标识符用来定义常数、变量、信号、端口、子程序或参数的名字, 由字母(A~Z,a~z)、数字(0~9)和下划线(_)字符组成。 要求:  首字符必须是字母  末字符不能为下划线  不允许出现两个连续的下划线  不区分大小写  VHDL定义的保留字(关键字),不能用作标识符  标识符字符最长可以是32个字符。 注释由两个连续的虚线(--)引导。
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