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Verilog HDL 基础语法入门2

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标签: FPGA

FPGA(Field-Programmable Gate Array),即现场可编程门阵列,它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。它是作为专用集成电路(ASIC)领域中的一种半定制电路而出现的,既解决了定制电路的不足,又克服了原有可编程器件门电路数有限的缺点。 系统设计师可以根据需要通过可编辑的连接把FPGA内部的逻辑块连接起来,就好像一个电路试验板被放在了一个芯片里。一个出厂后的成品FPGA的逻辑块和连接可以按照设计者而改变,所以FPGA可以完成所需要的逻辑功能。FPGA一般来说比ASIC(专用集成芯片)的速度要慢,无法完成复杂的设计,但是功耗较低。但是他们也有很多的优点比如可以快速成品,可以被修改来改正程序中的错误和更便宜的造价。厂商也可能会提供便宜的但是编辑能力差的FPGA。因为这些芯片有比较差的可编辑能力,所以这些设计的开发是在普通的FPGA上完成的,然后将设计转移到一个类似于ASIC的芯片上。

在一个过程块中,可以用两种不同的方式对信号变量或表达式进行连续赋值。

    过程连续赋值往往是不可以综合的,通常用在测试模块中。

      两种方式都有各自配套的命令来停止赋值过程。

      两种不同方式均不允许赋值语句间的时间控制。

    assign和deassign  适用于对寄存器类型的信号(例如:RTL级上

      的节点或测试模块中在多个地方被赋值的信号)进行赋值。

        initial    begin 

            #10    assign  top.dut.fsml.state_reg  =  `init_state;

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