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• FPGA设计经验之边沿检测
  在同步电路设计中，边沿检测是必不可少的！例如：在一个时钟频率16MHz的同步串行总线接收电路里，串行总线波特率为1Mbps。在串行总线的发送端是在同步时钟（1MHz）的上升沿输出数据，在接收端在同步时钟的下降沿对输入数据进行接收采样。在这个接收电路里检测同步时钟的下降沿是必不可少的。假设主时钟-clk，同步时钟-rck，同步数据-data。 有些人在边沿检测的时候就喜欢这样做：代码signalrc
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  我用的是F1611的单片机，IAR软件里面的设置都应该没有问题，其中JTAG口：1（地），2（悬空），3（＋3.3V），4（RST)，5（P2.2），6（P1.1），7（TCK）,8（TMS），9（TDI），10（TDO/TDI），其中出了5和6外其余的管脚都没有复用，以前这个JTAG用在F169上没有问题，可是现在用在F1611上却总提示找不到设备，请问大家有没有碰到过类似的情况啊？
• 小白求助 Bluenrg lp烧写问题
  bluenrg lp 345 用J link mini换winusb驱动 RF Flasher烧写官方skd（sdk1.2 mdk编译 器件选择bluenrg345）编译无措，烧写正常完成，但程序好像没有执行
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  [font=微软雅黑][size=3]经常有网友不了解论坛E金币是什么，有什么用，如何用E金币兑换礼品，怎么获得等等……[/size][/font][font=微软雅黑][size=3][b]下面就给大家解释下，[color=#ff0000]如果还有不清楚的地方欢迎跟帖提问[/color][/b][/size][/font][font=微软雅黑][size=3][color=#0000ff][b]
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