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高速异步FIFO的设计与实现

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  • 2013-09-20
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标签: 高速异步FIFO的设计与实现

高速异步FIFO的设计与实现

本文主要研究了用FPGA  芯片内部的EBRSRAM  来实现异步FIFO  设计方案,重点阐述了异步FIFO  的标志信号——空/满状态的设计思路,并且用VHDL  语言实现,最后进行了仿真验证。

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