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求大神指导怎么用verilog语言写出TM1803的功能
[b]求大神指导怎么用verilog语言写出TM1803的功能[/b][color=rgb(0, 0, 0)][font=Helvetica, Arial, sans-serif][align=left][font=Tahoma,]1、 所选FPGA：EP1C3T144C8。[/font][/align][align=left][font=Tahoma,]2、 能通过一根信号线完成数据的接收与解码
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嵌入式软件开发之： 复位和初始化
[font=宋体]转自 [url]http://power.21ic.com/digi/technical/201410/37255.html[/url] 13.5 复位和初始化[/font][font=宋体] 任何运行在实际硬件上的嵌入式应用程序，都必须在启动时实现一些基本的系统初始化。本节将对此予以详细讨论。[/font][font=宋体] 13.5.1 初始化序列[/font][font
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有没有接触过本安电源设计的，有没有2A24V的电源方案
RT，有没有大神接触过本安电源开关设计，有没有2A，24V输出的电源设计的方案，请大神分享一下。
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TMS320F28335生成SPWM
/** main.c*/#include DSP2833x_Project.hvoid InitEPwm1Example(void);void Gpio_Setup(void);interrupt void epwm1_isr(void);int N=60;float M=0.8;int i;float sina[30]={0.0000, 0.1081, 0.2150, 0.3193, 0.419
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请教一个verilog 程序！
前仿没有问题，用Quater 2编译也成功了，但后仿时出现网表文件错误……请高人指教……谢谢……`timescale 1ns/100ps`define clk_cycle 50module sim_all(clk,rst,rst1,wr_en,rd_en);input clk,rst,rst1,wr_en,rd_en;wire [7:0]d_out;wire clk_10mb;wire clk_o
- 问下：STM的16个大电流驱动
- 基于actel fpga的周期反馈式纯数字锁相环
- 求Mac OS X 下的开发工具
- 嵌入式amr 清华大学培训教程
- 此电路作用是什么
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