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路径度量存储器及其接口的设计
给出了由（2，1，N）系列卷积码Viterbi 译码中路径度量存储器及其接口的使用FPGA实现时的设计方法，译码器采用四个ACS 并行运算的方式，状态度量的更新采用乒乓模式，阐述了存储器的分块方法和读写地址及读写时钟的确定。设计充分利用了FPGA 内存资源丰富的特点，具有较高的译码速度和简单的控制逻辑。
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