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LVDS接收器中时钟数据恢复电路的研究与设计(1)

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标签: 电子

电子

LVDS接收器中时钟数据恢复电路的研究与设计(1)

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本文研究并设计了一种应用于平板显示领域的低电压差分信号(LVDS)接收器芯片,支持QXGA显示分辨率。LVDS技术以其高速、低功耗、低噪声等优势,在高速接口应用中日益广泛。本设计采用"自顶向下"和"由底向上"相结合的正向设计方法,重点研究时钟数据恢复(CDR)电路,提出了一种基于边沿追踪的CDR电路,有效解决了眼图抖动不对称的问题,并缩短了同步建立时间。通过Deskew模块和CDR模块的协同工作,实现了对多通道数据的统一采样,节省了芯片面积并降低了功耗。此外,设计了迟滞比较器,以在低频时减少功耗。整体仿真结果表明,该接收器芯片在1.2 Gbps的数据传输率下,能够容忍±250 ps的抖动和偏移,满足设计要求,并在低频时通过CDR模块使能关断进一步降低功耗,展现出良好的综合性能。

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