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Two-step split-junction SAR ADC

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标签: SAR

SAR

ADC

ADC

模数转换器

模数转换器

A  new  architecture  is  proposed  to  reduce  the  power  consumption  and  capacitor  area  in  successive-approximation  register  analogue-todigital  converters  (SAR  ADCs).  Two  split-junction  binary-weighted  capacitor  arrays  are  used  in  a  coarse/fine  quantisation  scheme.  This  reduces  both  the  power  consumption  and  the  capacitor  area  to  a  small  fraction  of  that  of  the  original  split-junction  SAR  ADC.

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