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一本quartus2的使用教程!全部中文的!
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Quartus 培训ppt,altera的内部网络搞得之DSPBuilder
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FPGA嵌入式应用系统开发典型实例
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Booth 算法的16×16 并行乘法器
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基于FPGA的DDS设计程序
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HDL Chip Design下载
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xilinx工具中文培训资料
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最好的SDC学习资料
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《基于Verilog HDL的通信系统设计》-陈曦-电子教案
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Digital Design and Computer Architecture, Second Edition
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fpga控制DDR2 400M设计参考
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有关时序setup,hold,skew,jitter
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CTS ( clock tree synthesis) In DSM (clock skew, low power issue)
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一些Design Compiler综合脚本
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Synopsys DC综合中文教程
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VHDL分频器设计--偶数、奇数、半整数、小数、分数、积分分频器
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Xilinx和Synopsys联合推出的FPGA设计的经典资料,强烈推荐!!
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时钟分频电路实现精讲_意法半导体Clock_Dividers_Made_Easy
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用systemverilog搭建基于VMM的验证平台实例
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高级verilog RTL 设计指导(重新发)
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Advanced asic chip synthesis use synopsys tool(中文版PPT)
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FFT 高速傅立叶变换的VHDL源代码 可以综合
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