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FPGA
该设计采用63位的pn码作为扩频调制的码序列,在发送端,对信息码进行扩频调制;在接收端,对收到的扩频调制信号进行解扩,增强了系统的抗干扰性和可靠性。同时在Altera公司的Quartus II软件中,使用硬件描述语言VHDL和原理图相结合的方法进行了电路的设计实现。通过把电路下载到Altera公司的CycloneIII 的EP3C10E144C8N芯片中调试,验证了扩频系统的可行性。
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