H.264中自适应二进制算术编码的IP核设计及其FPGA验证

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标签：中自适应二进制二进制算术算术编码

阐述H.264/AVC 二进制算术编码的原理，论述此编码的IP 核设计方案及其FPGA 验证。整个设计使用VerilogHDL 语言描述，在 ALDEC 的Active_HDL6.2 平台上进行时序仿真，在 Synplicity 的Synplify7.0平台上进行综合。设计充分利用了硬件并行性，并进行关键路径优化和复用器重构算法优化，通过实际验证证明了设计的高效性和可行性

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