本文提出了一种使用FPGA 实现误码率测试的设计及实现方法。该设计可通过FPGA 内建的异步串行接口向主控计算机传递误码信息，也可以通过数码管实时显示一段时间内的误码率。文章先介绍了系统构成和工作流程，然后重点分析了关键技术的实现。在通信系统的设计实现过程中，都需要测试系统的误码性能。而常见的误码率测试仪多数专用于测试各种标准高速信道，不便于测试实际应用中大量的专用信道，并且价格昂贵，搭建测试平台复杂。随着大规模集成电路的迅速发展，FPGA 在保持其集成度高，体积小，功耗低，性价比高特性的同时，能够实现越来越复杂设计功能，日益广泛的应用于通信设备的设计实现。本文提出了一种基于FPGA 的误码率测试仪的方案，使用一片Altera 公司的Cyclone系列的FPGA（EP1C6-144T）及相关的外围电路，实现误码测试功能，主控计算机可以通过FPGA 内建的异步串行接口（UART）配置误码测试仪并读取误码信息，由计算机完成误码分析。同时，该方案还提供了简易的数据显示，可以在脱离计算机的情况下，进行通信系统工作性能的定性分析。
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