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高速转换器时钟分配器件的端接

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  • 2013-09-22
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标签: 时钟分配

时钟分配

高速转换器

高速转换器

端接

端接

使用时钟分配器件1或者扇出缓冲器为  ADC  和  DAC  提供时钟 时,需要考虑印刷电路板上的走线和输出端接,这是信号衰减 的两个主要来源。 时钟走线与信号摆幅 PCB  上的走线类似于低通滤波器,当时钟信号沿着走线传输 时,会造成时钟信号衰减,并且脉冲沿的失真随线长增加。更 高的时钟信号频率会导致衰减、失真和噪声增加,但不会增加 抖动,在低压摆率时抖动最大(图  1),一般使用高压摆率的 时钟沿。为了实现高质量的时钟,要使用高摆幅时钟信号和短 时钟  PCB  走线;由时钟驱动的器件应该尽可能靠近时钟分配 器件放置。

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