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DesignCon 2014差分布线中文版

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标签：差分布线

DesignCon 2014差分布线中文版。差分布线最专业的指导，有实例讲解

差分信号线布线

Charles Pfeil

工程总监

–

高级产品开发

Mentor Graphics

其他½者：

John Mehlmauer – Broadcom

Chuck Ferry – Mentor Graphics

John Park – Mentor Graphics

Nitin Bhagwath – Mentor Graphics

DesignCon 2014

简介



目的



定义差分信号线布线时的信号完整性

(SI)

问题

确定这些问题在什么情况下会½响

展示解决这些问题的设计方法

特别关注极高的数据速率

需要处理各种差分信号约束的

PCB

设计者

希望减少此类约束并实现有效设计的工程师

讨论问题及其后果和设计解决方案

½用设计工具以生动的图½来演示这些解决方案



受众





方法



差分信号线布线

DesignCon 2014

Mentor Graphics

差分信号

–

采用的原因和工½方式



为什么½用差分信号而不是单端信号？



½差分信号正确布线时，受

RFI

和

EMI

噪声的½响较小且更不易

产生

EMI。

即½信号损耗较大，仍可继续工½

驱动器产生两个具有相同振幅、½极性相反的两个互补信号

接收器检测电压差并½够读取信号的极性变换

某些差分电路½够补偿偏移和损耗

用于切换事件、数据传输或时钟信号



如½工½？



差分信号线布线

DesignCon 2014

Mentor Graphics

差分信号

–

定义



可½会遇到什么问题？



如果在接收器上读取到的差分信号过度失真，可½会无法识别时序和

电压差，电路将失效

不恰½的布线可½会削弱差分信号按预期工½的½力

在多种因素的共同½用下，很难½用差分信号实现成功的设计

理解这些因素并掌握规避相关½响的设计技术是成功布线的关键

差分信号线布线

DesignCon 2014

Mentor Graphics

假设



紧耦合并行布线



本演示文档详细描述了紧耦合布线的方法

在相同层上布设½此靠近、信号互补的走线，同时通过走线的½度

和间距来控制阻抗

“紧耦合”布线方法的设计意图

通过具有同一参考平面的相同环境来布设走线，从而最小化

EMI

½响

保持一致的阻抗以减少反射

最大限度降½与其他信号的相互½用和½响

差分信号线布线

DesignCon 2014

Mentor Graphics

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: p61516655; 很棒，可以细致学习下，谢谢; 2018-07-05 15:38:21回复

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