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中规模集成时序逻辑设计

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标签：中规模集成时序逻辑设计

中规模集成时序逻辑设计:计数器:在数字逻辑系统中，使用最多的时序电路要算计数器了。它是一种对输入脉冲信号进行计数的时序逻辑部件。9.1.1 计数器的分类1.按数制分（1）二进制计数器。按自然态序循环经历2n个独立状态，因此又可称作模M=2n进制计数器。（2）非二进制计数器。在计数时所经历的独立状态数不为M≠2n，称为非二进制计数器。如十进制、八进制、十二进制、十六进制计数器等。（1）加计数器。按输入一个脉冲就进行一次加1运算的计数器称为加计数器。

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